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Electrical Diagrams
47DVD963SA 7.
AV-Board: Clock & Control
INTERRUPT
LOGIC
LP FILTER
INPUT
FILTER
I
2
C BUS
CONTROL
POWER-ON
RESET
I/O
PORTS
SHIFT
REGISTER
8BIT
FROM 1001 OF SACHI4.0 MONO BOARD
V DC Vtg measured in STOP-MODE
SYS CLK & CONTROL
I
1100 C5
1101 B9
1102 C5
1200 G1
1400 B1
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3100 C2
3101 C2
3V3
2V4
A3
A3
A3
*
A6
A6
SDA_5V
TO/FROM 1108 OF
DISPLAY BOARD
A6
A6
A1,A2
12345678910111213
12345
3V3
A2
A2
A1,A2
*
AT-49
*
6 7 8 9 10111213
A
B
C
D
E
F
G
H
I
A
B
C
D
E
F
G
H
24.576 SMD
PCM_CLK
3102 C2
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3104 D2
3105 D2
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3107 E2
3108 E2
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3115 F9
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3118 H7
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4100 F2
33.8688 SMD
0R
384 FS
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7106-D E6
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I101 C2
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I103 C2
I104 C1
I105 C2
*
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I110 D1
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I115 E2
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I117 F2
I118 E1
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I126 I1
I127 I1
I128 I1
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I134 B6
I135 B10
I136 C6
I137 C13
I140 E13
0R
BARE BOARD : 3139-243-30533
SCL_5V
33.8688 TH
* RESERVED
I141 E8
I142 E9
I143 G8
I144 G11
I145 H8
I146 H8
I147 H8
I148 H9
I149 H11
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I151 F1
I152 G1
I154 A9
I156 B11
I158 G8
I159 G8
A1,A3
A1,A3
A6
A6
*
*
3V3
1V6
1V6
A2,A3
0V
1V6
1V6
0V
3V3
3V3
0V
0V
0V
3V3
0V
3V3
3V3
0V
A3
A3
A3
1V6
1V6
1V6 1V6
1V6
1V6 1V6
1V6
1V6
1V6
1V6
1V6 1V6 1V6
1V6
1V6
3V3
0V
0V
3126
3K3
A3
A3
A2,A3
A2,A3
A2,A3
A1
FOR DEV
EVALUATION
A1
A1
A2
A2
A3
A1,A2
A4
A1
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3119
+3V3D
12p
2118
+3V3D
I116
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3125
I136
+3V3D
+3V3D
3117
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I110
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I146
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34
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1M
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3103
100R
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+3V3D
+3V3D
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100R
3101
I128
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2
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3
A2
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SCL
I149
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I108
+3V3D
+3V3D
I158
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+3V3D
+3V3D
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100R
I134
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I159
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I101
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100R
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I129
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I148
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27
28
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I127
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I154
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15p
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12p
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6
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TC7WHU04FU
7103-B
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1100
4K7
3109
I119
3132
TC7WHU04FU
7101-A
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7106-B
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+5VSTBY
4100
I122
39p
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2109
10u
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I135
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1M
I124
Upsampling
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24.576M
192K_96K
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STDBY_CTRL
P50
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CDATA
CLATCH
SEL3
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LRCLK
SPDIF_MUTE
SCL_3V3
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CLK_SEL
RESET
CENTER_ON
CL 26532105_005.eps
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I133
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I103
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I107
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I115
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